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德州仪器 DDR3 Memory Controlle用户手册英文版免费下载
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KeyStone II Architecture
DDR3 Memory Controller
Contents
Release History. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
List of Tables. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
List of Figures . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Preface
About This Manual. . . . . . . . . . . . . . . . . . . . . . . . . .
Notational Conventions. . . . . . . . . . . . . . . . . . . . .
Related Documentation from Texas Instrume
Trademarks. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Chapter 1
Introduction
1.1Purpose of the Peripheral . . . . . . . . . . . . . . .
1.2Features. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1.3Industry Standard(s) Compliance Statem
Chapter 2
Peripheral Architecture
2.1Clock Interface. . . . . . . . . . . . . . . . . . . . . . . . . .
2.2SDRAM Memory Map . . . . . . . . . . . . . . . . . . .
2.3Signal Descriptions . . . . . . . . . . . . . . . . . . . . .
2.4Protocol Descriptions . . . . . . . . . . . . . . . . . . .
2.4.1Mode Register Set (MRS or EMRS). . . . . .
2.4.2Refresh Mode. . . . . . . . . . . . . . . . . . . . . . . . .
2.4.3Activation . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.4Deactivation. . . . . . . . . . . . . . . . . . . . . . . . . .
2.4.5READ Command . . . . . . . . . . . . . . . . . . . . . .
2.4.6Write (WR) Command . . . . . . . . . . . . . . . . .
2.5Address Mapping. . . . . . . . . . . . . . . . . . . . . . .
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